Merge tag 'amlogic-drivers-2.1' of git://git.kernel.org/pub/scm/linux/kernel/git/khilman/linux-amlogic into arm/drivers
soc: amlogic: updates for v5.4 (round 2) - add power domain controller * tag 'amlogic-drivers-2.1' of git://git.kernel.org/pub/scm/linux/kernel/git/khilman/linux-amlogic: dt-bindings: power: add Amlogic Everything-Else power domains bindings soc: amlogic: Add support for Everything-Else power domains controller Link: https://patchwork.kernel.org/patch/11122205/ Signed-off-by: Arnd Bergmann <arnd@arndb.de>
This commit is contained in:
Arnd Bergmann
@@ -0,0 +1,93 @@
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# SPDX-License-Identifier: (GPL-2.0 OR BSD-2-Clause)
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|
# Copyright 2019 BayLibre, SAS
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%YAML 1.2
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|
---
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$id: "http://devicetree.org/schemas/power/amlogic,meson-ee-pwrc.yaml#"
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||||||
|
$schema: "http://devicetree.org/meta-schemas/core.yaml#"
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title: Amlogic Meson Everything-Else Power Domains
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maintainers:
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- Neil Armstrong <narmstrong@baylibre.com>
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description: |+
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The Everything-Else Power Domains node should be the child of a syscon
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node with the required property:
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- compatible: Should be the following:
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"amlogic,meson-gx-hhi-sysctrl", "simple-mfd", "syscon"
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Refer to the the bindings described in
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Documentation/devicetree/bindings/mfd/syscon.txt
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properties:
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|
compatible:
|
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enum:
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- amlogic,meson-g12a-pwrc
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|
- amlogic,meson-sm1-pwrc
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clocks:
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minItems: 2
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clock-names:
|
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|
items:
|
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- const: vpu
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||||||
|
- const: vapb
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||||||
|
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|
resets:
|
||||||
|
minItems: 11
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|
|
||||||
|
reset-names:
|
||||||
|
items:
|
||||||
|
- const: viu
|
||||||
|
- const: venc
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||||||
|
- const: vcbus
|
||||||
|
- const: bt656
|
||||||
|
- const: rdma
|
||||||
|
- const: venci
|
||||||
|
- const: vencp
|
||||||
|
- const: vdac
|
||||||
|
- const: vdi6
|
||||||
|
- const: vencl
|
||||||
|
- const: vid_lock
|
||||||
|
|
||||||
|
"#power-domain-cells":
|
||||||
|
const: 1
|
||||||
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||||||
|
amlogic,ao-sysctrl:
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||||||
|
description: phandle to the AO sysctrl node
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allOf:
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|
- $ref: /schemas/types.yaml#/definitions/phandle
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|
required:
|
||||||
|
- compatible
|
||||||
|
- clocks
|
||||||
|
- clock-names
|
||||||
|
- resets
|
||||||
|
- reset-names
|
||||||
|
- "#power-domain-cells"
|
||||||
|
- amlogic,ao-sysctrl
|
||||||
|
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||||||
|
examples:
|
||||||
|
- |
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|
pwrc: power-controller {
|
||||||
|
compatible = "amlogic,meson-sm1-pwrc";
|
||||||
|
#power-domain-cells = <1>;
|
||||||
|
amlogic,ao-sysctrl = <&rti>;
|
||||||
|
resets = <&reset_viu>,
|
||||||
|
<&reset_venc>,
|
||||||
|
<&reset_vcbus>,
|
||||||
|
<&reset_bt656>,
|
||||||
|
<&reset_rdma>,
|
||||||
|
<&reset_venci>,
|
||||||
|
<&reset_vencp>,
|
||||||
|
<&reset_vdac>,
|
||||||
|
<&reset_vdi6>,
|
||||||
|
<&reset_vencl>,
|
||||||
|
<&reset_vid_lock>;
|
||||||
|
reset-names = "viu", "venc", "vcbus", "bt656",
|
||||||
|
"rdma", "venci", "vencp", "vdac",
|
||||||
|
"vdi6", "vencl", "vid_lock";
|
||||||
|
clocks = <&clk_vpu>, <&clk_vapb>;
|
||||||
|
clock-names = "vpu", "vapb";
|
||||||
|
};
|
||||||
@@ -37,6 +37,17 @@ config MESON_GX_PM_DOMAINS
|
|||||||
Say yes to expose Amlogic Meson GX Power Domains as
|
Say yes to expose Amlogic Meson GX Power Domains as
|
||||||
Generic Power Domains.
|
Generic Power Domains.
|
||||||
|
|
||||||
|
config MESON_EE_PM_DOMAINS
|
||||||
|
bool "Amlogic Meson Everything-Else Power Domains driver"
|
||||||
|
depends on ARCH_MESON || COMPILE_TEST
|
||||||
|
depends on PM && OF
|
||||||
|
default ARCH_MESON
|
||||||
|
select PM_GENERIC_DOMAINS
|
||||||
|
select PM_GENERIC_DOMAINS_OF
|
||||||
|
help
|
||||||
|
Say yes to expose Amlogic Meson Everything-Else Power Domains as
|
||||||
|
Generic Power Domains.
|
||||||
|
|
||||||
config MESON_MX_SOCINFO
|
config MESON_MX_SOCINFO
|
||||||
bool "Amlogic Meson MX SoC Information driver"
|
bool "Amlogic Meson MX SoC Information driver"
|
||||||
depends on ARCH_MESON || COMPILE_TEST
|
depends on ARCH_MESON || COMPILE_TEST
|
||||||
|
|||||||
@@ -4,3 +4,4 @@ obj-$(CONFIG_MESON_CLK_MEASURE) += meson-clk-measure.o
|
|||||||
obj-$(CONFIG_MESON_GX_SOCINFO) += meson-gx-socinfo.o
|
obj-$(CONFIG_MESON_GX_SOCINFO) += meson-gx-socinfo.o
|
||||||
obj-$(CONFIG_MESON_GX_PM_DOMAINS) += meson-gx-pwrc-vpu.o
|
obj-$(CONFIG_MESON_GX_PM_DOMAINS) += meson-gx-pwrc-vpu.o
|
||||||
obj-$(CONFIG_MESON_MX_SOCINFO) += meson-mx-socinfo.o
|
obj-$(CONFIG_MESON_MX_SOCINFO) += meson-mx-socinfo.o
|
||||||
|
obj-$(CONFIG_MESON_EE_PM_DOMAINS) += meson-ee-pwrc.o
|
||||||
|
|||||||
492
drivers/soc/amlogic/meson-ee-pwrc.c
Normal file
492
drivers/soc/amlogic/meson-ee-pwrc.c
Normal file
@@ -0,0 +1,492 @@
|
|||||||
|
// SPDX-License-Identifier: GPL-2.0+
|
||||||
|
/*
|
||||||
|
* Copyright (c) 2019 BayLibre, SAS
|
||||||
|
* Author: Neil Armstrong <narmstrong@baylibre.com>
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||||||
|
*/
|
||||||
|
|
||||||
|
#include <linux/of_address.h>
|
||||||
|
#include <linux/platform_device.h>
|
||||||
|
#include <linux/pm_domain.h>
|
||||||
|
#include <linux/bitfield.h>
|
||||||
|
#include <linux/regmap.h>
|
||||||
|
#include <linux/mfd/syscon.h>
|
||||||
|
#include <linux/of_device.h>
|
||||||
|
#include <linux/reset-controller.h>
|
||||||
|
#include <linux/reset.h>
|
||||||
|
#include <linux/clk.h>
|
||||||
|
#include <dt-bindings/power/meson-g12a-power.h>
|
||||||
|
#include <dt-bindings/power/meson-sm1-power.h>
|
||||||
|
|
||||||
|
/* AO Offsets */
|
||||||
|
|
||||||
|
#define AO_RTI_GEN_PWR_SLEEP0 (0x3a << 2)
|
||||||
|
#define AO_RTI_GEN_PWR_ISO0 (0x3b << 2)
|
||||||
|
|
||||||
|
/* HHI Offsets */
|
||||||
|
|
||||||
|
#define HHI_MEM_PD_REG0 (0x40 << 2)
|
||||||
|
#define HHI_VPU_MEM_PD_REG0 (0x41 << 2)
|
||||||
|
#define HHI_VPU_MEM_PD_REG1 (0x42 << 2)
|
||||||
|
#define HHI_VPU_MEM_PD_REG3 (0x43 << 2)
|
||||||
|
#define HHI_VPU_MEM_PD_REG4 (0x44 << 2)
|
||||||
|
#define HHI_AUDIO_MEM_PD_REG0 (0x45 << 2)
|
||||||
|
#define HHI_NANOQ_MEM_PD_REG0 (0x46 << 2)
|
||||||
|
#define HHI_NANOQ_MEM_PD_REG1 (0x47 << 2)
|
||||||
|
#define HHI_VPU_MEM_PD_REG2 (0x4d << 2)
|
||||||
|
|
||||||
|
struct meson_ee_pwrc;
|
||||||
|
struct meson_ee_pwrc_domain;
|
||||||
|
|
||||||
|
struct meson_ee_pwrc_mem_domain {
|
||||||
|
unsigned int reg;
|
||||||
|
unsigned int mask;
|
||||||
|
};
|
||||||
|
|
||||||
|
struct meson_ee_pwrc_top_domain {
|
||||||
|
unsigned int sleep_reg;
|
||||||
|
unsigned int sleep_mask;
|
||||||
|
unsigned int iso_reg;
|
||||||
|
unsigned int iso_mask;
|
||||||
|
};
|
||||||
|
|
||||||
|
struct meson_ee_pwrc_domain_desc {
|
||||||
|
char *name;
|
||||||
|
unsigned int reset_names_count;
|
||||||
|
unsigned int clk_names_count;
|
||||||
|
struct meson_ee_pwrc_top_domain *top_pd;
|
||||||
|
unsigned int mem_pd_count;
|
||||||
|
struct meson_ee_pwrc_mem_domain *mem_pd;
|
||||||
|
bool (*get_power)(struct meson_ee_pwrc_domain *pwrc_domain);
|
||||||
|
};
|
||||||
|
|
||||||
|
struct meson_ee_pwrc_domain_data {
|
||||||
|
unsigned int count;
|
||||||
|
struct meson_ee_pwrc_domain_desc *domains;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* TOP Power Domains */
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_top_domain g12a_pwrc_vpu = {
|
||||||
|
.sleep_reg = AO_RTI_GEN_PWR_SLEEP0,
|
||||||
|
.sleep_mask = BIT(8),
|
||||||
|
.iso_reg = AO_RTI_GEN_PWR_SLEEP0,
|
||||||
|
.iso_mask = BIT(9),
|
||||||
|
};
|
||||||
|
|
||||||
|
#define SM1_EE_PD(__bit) \
|
||||||
|
{ \
|
||||||
|
.sleep_reg = AO_RTI_GEN_PWR_SLEEP0, \
|
||||||
|
.sleep_mask = BIT(__bit), \
|
||||||
|
.iso_reg = AO_RTI_GEN_PWR_ISO0, \
|
||||||
|
.iso_mask = BIT(__bit), \
|
||||||
|
}
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_top_domain sm1_pwrc_vpu = SM1_EE_PD(8);
|
||||||
|
static struct meson_ee_pwrc_top_domain sm1_pwrc_nna = SM1_EE_PD(16);
|
||||||
|
static struct meson_ee_pwrc_top_domain sm1_pwrc_usb = SM1_EE_PD(17);
|
||||||
|
static struct meson_ee_pwrc_top_domain sm1_pwrc_pci = SM1_EE_PD(18);
|
||||||
|
static struct meson_ee_pwrc_top_domain sm1_pwrc_ge2d = SM1_EE_PD(19);
|
||||||
|
|
||||||
|
/* Memory PD Domains */
|
||||||
|
|
||||||
|
#define VPU_MEMPD(__reg) \
|
||||||
|
{ __reg, GENMASK(1, 0) }, \
|
||||||
|
{ __reg, GENMASK(3, 2) }, \
|
||||||
|
{ __reg, GENMASK(5, 4) }, \
|
||||||
|
{ __reg, GENMASK(7, 6) }, \
|
||||||
|
{ __reg, GENMASK(9, 8) }, \
|
||||||
|
{ __reg, GENMASK(11, 10) }, \
|
||||||
|
{ __reg, GENMASK(13, 12) }, \
|
||||||
|
{ __reg, GENMASK(15, 14) }, \
|
||||||
|
{ __reg, GENMASK(17, 16) }, \
|
||||||
|
{ __reg, GENMASK(19, 18) }, \
|
||||||
|
{ __reg, GENMASK(21, 20) }, \
|
||||||
|
{ __reg, GENMASK(23, 22) }, \
|
||||||
|
{ __reg, GENMASK(25, 24) }, \
|
||||||
|
{ __reg, GENMASK(27, 26) }, \
|
||||||
|
{ __reg, GENMASK(29, 28) }, \
|
||||||
|
{ __reg, GENMASK(31, 30) }
|
||||||
|
|
||||||
|
#define VPU_HHI_MEMPD(__reg) \
|
||||||
|
{ __reg, BIT(8) }, \
|
||||||
|
{ __reg, BIT(9) }, \
|
||||||
|
{ __reg, BIT(10) }, \
|
||||||
|
{ __reg, BIT(11) }, \
|
||||||
|
{ __reg, BIT(12) }, \
|
||||||
|
{ __reg, BIT(13) }, \
|
||||||
|
{ __reg, BIT(14) }, \
|
||||||
|
{ __reg, BIT(15) }
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_mem_domain g12a_pwrc_mem_vpu[] = {
|
||||||
|
VPU_MEMPD(HHI_VPU_MEM_PD_REG0),
|
||||||
|
VPU_MEMPD(HHI_VPU_MEM_PD_REG1),
|
||||||
|
VPU_MEMPD(HHI_VPU_MEM_PD_REG2),
|
||||||
|
VPU_HHI_MEMPD(HHI_MEM_PD_REG0),
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_mem_domain g12a_pwrc_mem_eth[] = {
|
||||||
|
{ HHI_MEM_PD_REG0, GENMASK(3, 2) },
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_mem_domain sm1_pwrc_mem_vpu[] = {
|
||||||
|
VPU_MEMPD(HHI_VPU_MEM_PD_REG0),
|
||||||
|
VPU_MEMPD(HHI_VPU_MEM_PD_REG1),
|
||||||
|
VPU_MEMPD(HHI_VPU_MEM_PD_REG2),
|
||||||
|
VPU_MEMPD(HHI_VPU_MEM_PD_REG3),
|
||||||
|
{ HHI_VPU_MEM_PD_REG4, GENMASK(1, 0) },
|
||||||
|
{ HHI_VPU_MEM_PD_REG4, GENMASK(3, 2) },
|
||||||
|
{ HHI_VPU_MEM_PD_REG4, GENMASK(5, 4) },
|
||||||
|
{ HHI_VPU_MEM_PD_REG4, GENMASK(7, 6) },
|
||||||
|
VPU_HHI_MEMPD(HHI_MEM_PD_REG0),
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_mem_domain sm1_pwrc_mem_nna[] = {
|
||||||
|
{ HHI_NANOQ_MEM_PD_REG0, 0xff },
|
||||||
|
{ HHI_NANOQ_MEM_PD_REG1, 0xff },
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_mem_domain sm1_pwrc_mem_usb[] = {
|
||||||
|
{ HHI_MEM_PD_REG0, GENMASK(31, 30) },
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_mem_domain sm1_pwrc_mem_pcie[] = {
|
||||||
|
{ HHI_MEM_PD_REG0, GENMASK(29, 26) },
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_mem_domain sm1_pwrc_mem_ge2d[] = {
|
||||||
|
{ HHI_MEM_PD_REG0, GENMASK(25, 18) },
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_mem_domain sm1_pwrc_mem_audio[] = {
|
||||||
|
{ HHI_MEM_PD_REG0, GENMASK(5, 4) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(1, 0) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(3, 2) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(5, 4) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(7, 6) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(13, 12) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(15, 14) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(17, 16) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(19, 18) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(21, 20) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(23, 22) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(25, 24) },
|
||||||
|
{ HHI_AUDIO_MEM_PD_REG0, GENMASK(27, 26) },
|
||||||
|
};
|
||||||
|
|
||||||
|
#define VPU_PD(__name, __top_pd, __mem, __get_power, __resets, __clks) \
|
||||||
|
{ \
|
||||||
|
.name = __name, \
|
||||||
|
.reset_names_count = __resets, \
|
||||||
|
.clk_names_count = __clks, \
|
||||||
|
.top_pd = __top_pd, \
|
||||||
|
.mem_pd_count = ARRAY_SIZE(__mem), \
|
||||||
|
.mem_pd = __mem, \
|
||||||
|
.get_power = __get_power, \
|
||||||
|
}
|
||||||
|
|
||||||
|
#define TOP_PD(__name, __top_pd, __mem, __get_power) \
|
||||||
|
{ \
|
||||||
|
.name = __name, \
|
||||||
|
.top_pd = __top_pd, \
|
||||||
|
.mem_pd_count = ARRAY_SIZE(__mem), \
|
||||||
|
.mem_pd = __mem, \
|
||||||
|
.get_power = __get_power, \
|
||||||
|
}
|
||||||
|
|
||||||
|
#define MEM_PD(__name, __mem) \
|
||||||
|
TOP_PD(__name, NULL, __mem, NULL)
|
||||||
|
|
||||||
|
static bool pwrc_ee_get_power(struct meson_ee_pwrc_domain *pwrc_domain);
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_domain_desc g12a_pwrc_domains[] = {
|
||||||
|
[PWRC_G12A_VPU_ID] = VPU_PD("VPU", &g12a_pwrc_vpu, g12a_pwrc_mem_vpu,
|
||||||
|
pwrc_ee_get_power, 11, 2),
|
||||||
|
[PWRC_G12A_ETH_ID] = MEM_PD("ETH", g12a_pwrc_mem_eth),
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_domain_desc sm1_pwrc_domains[] = {
|
||||||
|
[PWRC_SM1_VPU_ID] = VPU_PD("VPU", &sm1_pwrc_vpu, sm1_pwrc_mem_vpu,
|
||||||
|
pwrc_ee_get_power, 11, 2),
|
||||||
|
[PWRC_SM1_NNA_ID] = TOP_PD("NNA", &sm1_pwrc_nna, sm1_pwrc_mem_nna,
|
||||||
|
pwrc_ee_get_power),
|
||||||
|
[PWRC_SM1_USB_ID] = TOP_PD("USB", &sm1_pwrc_usb, sm1_pwrc_mem_usb,
|
||||||
|
pwrc_ee_get_power),
|
||||||
|
[PWRC_SM1_PCIE_ID] = TOP_PD("PCI", &sm1_pwrc_pci, sm1_pwrc_mem_pcie,
|
||||||
|
pwrc_ee_get_power),
|
||||||
|
[PWRC_SM1_GE2D_ID] = TOP_PD("GE2D", &sm1_pwrc_ge2d, sm1_pwrc_mem_ge2d,
|
||||||
|
pwrc_ee_get_power),
|
||||||
|
[PWRC_SM1_AUDIO_ID] = MEM_PD("AUDIO", sm1_pwrc_mem_audio),
|
||||||
|
[PWRC_SM1_ETH_ID] = MEM_PD("ETH", g12a_pwrc_mem_eth),
|
||||||
|
};
|
||||||
|
|
||||||
|
struct meson_ee_pwrc_domain {
|
||||||
|
struct generic_pm_domain base;
|
||||||
|
bool enabled;
|
||||||
|
struct meson_ee_pwrc *pwrc;
|
||||||
|
struct meson_ee_pwrc_domain_desc desc;
|
||||||
|
struct clk_bulk_data *clks;
|
||||||
|
int num_clks;
|
||||||
|
struct reset_control *rstc;
|
||||||
|
int num_rstc;
|
||||||
|
};
|
||||||
|
|
||||||
|
struct meson_ee_pwrc {
|
||||||
|
struct regmap *regmap_ao;
|
||||||
|
struct regmap *regmap_hhi;
|
||||||
|
struct meson_ee_pwrc_domain *domains;
|
||||||
|
struct genpd_onecell_data xlate;
|
||||||
|
};
|
||||||
|
|
||||||
|
static bool pwrc_ee_get_power(struct meson_ee_pwrc_domain *pwrc_domain)
|
||||||
|
{
|
||||||
|
u32 reg;
|
||||||
|
|
||||||
|
regmap_read(pwrc_domain->pwrc->regmap_ao,
|
||||||
|
pwrc_domain->desc.top_pd->sleep_reg, ®);
|
||||||
|
|
||||||
|
return (reg & pwrc_domain->desc.top_pd->sleep_mask);
|
||||||
|
}
|
||||||
|
|
||||||
|
static int meson_ee_pwrc_off(struct generic_pm_domain *domain)
|
||||||
|
{
|
||||||
|
struct meson_ee_pwrc_domain *pwrc_domain =
|
||||||
|
container_of(domain, struct meson_ee_pwrc_domain, base);
|
||||||
|
int i;
|
||||||
|
|
||||||
|
if (pwrc_domain->desc.top_pd)
|
||||||
|
regmap_update_bits(pwrc_domain->pwrc->regmap_ao,
|
||||||
|
pwrc_domain->desc.top_pd->sleep_reg,
|
||||||
|
pwrc_domain->desc.top_pd->sleep_mask,
|
||||||
|
pwrc_domain->desc.top_pd->sleep_mask);
|
||||||
|
udelay(20);
|
||||||
|
|
||||||
|
for (i = 0 ; i < pwrc_domain->desc.mem_pd_count ; ++i)
|
||||||
|
regmap_update_bits(pwrc_domain->pwrc->regmap_hhi,
|
||||||
|
pwrc_domain->desc.mem_pd[i].reg,
|
||||||
|
pwrc_domain->desc.mem_pd[i].mask,
|
||||||
|
pwrc_domain->desc.mem_pd[i].mask);
|
||||||
|
|
||||||
|
udelay(20);
|
||||||
|
|
||||||
|
if (pwrc_domain->desc.top_pd)
|
||||||
|
regmap_update_bits(pwrc_domain->pwrc->regmap_ao,
|
||||||
|
pwrc_domain->desc.top_pd->iso_reg,
|
||||||
|
pwrc_domain->desc.top_pd->iso_mask,
|
||||||
|
pwrc_domain->desc.top_pd->iso_mask);
|
||||||
|
|
||||||
|
if (pwrc_domain->num_clks) {
|
||||||
|
msleep(20);
|
||||||
|
clk_bulk_disable_unprepare(pwrc_domain->num_clks,
|
||||||
|
pwrc_domain->clks);
|
||||||
|
}
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int meson_ee_pwrc_on(struct generic_pm_domain *domain)
|
||||||
|
{
|
||||||
|
struct meson_ee_pwrc_domain *pwrc_domain =
|
||||||
|
container_of(domain, struct meson_ee_pwrc_domain, base);
|
||||||
|
int i, ret;
|
||||||
|
|
||||||
|
if (pwrc_domain->desc.top_pd)
|
||||||
|
regmap_update_bits(pwrc_domain->pwrc->regmap_ao,
|
||||||
|
pwrc_domain->desc.top_pd->sleep_reg,
|
||||||
|
pwrc_domain->desc.top_pd->sleep_mask, 0);
|
||||||
|
udelay(20);
|
||||||
|
|
||||||
|
for (i = 0 ; i < pwrc_domain->desc.mem_pd_count ; ++i)
|
||||||
|
regmap_update_bits(pwrc_domain->pwrc->regmap_hhi,
|
||||||
|
pwrc_domain->desc.mem_pd[i].reg,
|
||||||
|
pwrc_domain->desc.mem_pd[i].mask, 0);
|
||||||
|
|
||||||
|
udelay(20);
|
||||||
|
|
||||||
|
ret = reset_control_assert(pwrc_domain->rstc);
|
||||||
|
if (ret)
|
||||||
|
return ret;
|
||||||
|
|
||||||
|
if (pwrc_domain->desc.top_pd)
|
||||||
|
regmap_update_bits(pwrc_domain->pwrc->regmap_ao,
|
||||||
|
pwrc_domain->desc.top_pd->iso_reg,
|
||||||
|
pwrc_domain->desc.top_pd->iso_mask, 0);
|
||||||
|
|
||||||
|
ret = reset_control_deassert(pwrc_domain->rstc);
|
||||||
|
if (ret)
|
||||||
|
return ret;
|
||||||
|
|
||||||
|
return clk_bulk_prepare_enable(pwrc_domain->num_clks,
|
||||||
|
pwrc_domain->clks);
|
||||||
|
}
|
||||||
|
|
||||||
|
static int meson_ee_pwrc_init_domain(struct platform_device *pdev,
|
||||||
|
struct meson_ee_pwrc *pwrc,
|
||||||
|
struct meson_ee_pwrc_domain *dom)
|
||||||
|
{
|
||||||
|
dom->pwrc = pwrc;
|
||||||
|
dom->num_rstc = dom->desc.reset_names_count;
|
||||||
|
dom->num_clks = dom->desc.clk_names_count;
|
||||||
|
|
||||||
|
if (dom->num_rstc) {
|
||||||
|
int count = reset_control_get_count(&pdev->dev);
|
||||||
|
|
||||||
|
if (count != dom->num_rstc)
|
||||||
|
dev_warn(&pdev->dev, "Invalid resets count %d for domain %s\n",
|
||||||
|
count, dom->desc.name);
|
||||||
|
|
||||||
|
dom->rstc = devm_reset_control_array_get(&pdev->dev, false,
|
||||||
|
false);
|
||||||
|
if (IS_ERR(dom->rstc))
|
||||||
|
return PTR_ERR(dom->rstc);
|
||||||
|
}
|
||||||
|
|
||||||
|
if (dom->num_clks) {
|
||||||
|
int ret = devm_clk_bulk_get_all(&pdev->dev, &dom->clks);
|
||||||
|
if (ret < 0)
|
||||||
|
return ret;
|
||||||
|
|
||||||
|
if (dom->num_clks != ret) {
|
||||||
|
dev_warn(&pdev->dev, "Invalid clocks count %d for domain %s\n",
|
||||||
|
ret, dom->desc.name);
|
||||||
|
dom->num_clks = ret;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
dom->base.name = dom->desc.name;
|
||||||
|
dom->base.power_on = meson_ee_pwrc_on;
|
||||||
|
dom->base.power_off = meson_ee_pwrc_off;
|
||||||
|
|
||||||
|
/*
|
||||||
|
* TOFIX: This is a special case for the VPU power domain, which can
|
||||||
|
* be enabled previously by the bootloader. In this case the VPU
|
||||||
|
* pipeline may be functional but no driver maybe never attach
|
||||||
|
* to this power domain, and if the domain is disabled it could
|
||||||
|
* cause system errors. This is why the pm_domain_always_on_gov
|
||||||
|
* is used here.
|
||||||
|
* For the same reason, the clocks should be enabled in case
|
||||||
|
* we need to power the domain off, otherwise the internal clocks
|
||||||
|
* prepare/enable counters won't be in sync.
|
||||||
|
*/
|
||||||
|
if (dom->num_clks && dom->desc.get_power && !dom->desc.get_power(dom)) {
|
||||||
|
int ret = clk_bulk_prepare_enable(dom->num_clks, dom->clks);
|
||||||
|
if (ret)
|
||||||
|
return ret;
|
||||||
|
|
||||||
|
pm_genpd_init(&dom->base, &pm_domain_always_on_gov, false);
|
||||||
|
} else
|
||||||
|
pm_genpd_init(&dom->base, NULL,
|
||||||
|
(dom->desc.get_power ?
|
||||||
|
dom->desc.get_power(dom) : true));
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static int meson_ee_pwrc_probe(struct platform_device *pdev)
|
||||||
|
{
|
||||||
|
const struct meson_ee_pwrc_domain_data *match;
|
||||||
|
struct regmap *regmap_ao, *regmap_hhi;
|
||||||
|
struct meson_ee_pwrc *pwrc;
|
||||||
|
int i, ret;
|
||||||
|
|
||||||
|
match = of_device_get_match_data(&pdev->dev);
|
||||||
|
if (!match) {
|
||||||
|
dev_err(&pdev->dev, "failed to get match data\n");
|
||||||
|
return -ENODEV;
|
||||||
|
}
|
||||||
|
|
||||||
|
pwrc = devm_kzalloc(&pdev->dev, sizeof(*pwrc), GFP_KERNEL);
|
||||||
|
if (!pwrc)
|
||||||
|
return -ENOMEM;
|
||||||
|
|
||||||
|
pwrc->xlate.domains = devm_kcalloc(&pdev->dev, match->count,
|
||||||
|
sizeof(*pwrc->xlate.domains),
|
||||||
|
GFP_KERNEL);
|
||||||
|
if (!pwrc->xlate.domains)
|
||||||
|
return -ENOMEM;
|
||||||
|
|
||||||
|
pwrc->domains = devm_kcalloc(&pdev->dev, match->count,
|
||||||
|
sizeof(*pwrc->domains), GFP_KERNEL);
|
||||||
|
if (!pwrc->domains)
|
||||||
|
return -ENOMEM;
|
||||||
|
|
||||||
|
pwrc->xlate.num_domains = match->count;
|
||||||
|
|
||||||
|
regmap_hhi = syscon_node_to_regmap(of_get_parent(pdev->dev.of_node));
|
||||||
|
if (IS_ERR(regmap_hhi)) {
|
||||||
|
dev_err(&pdev->dev, "failed to get HHI regmap\n");
|
||||||
|
return PTR_ERR(regmap_hhi);
|
||||||
|
}
|
||||||
|
|
||||||
|
regmap_ao = syscon_regmap_lookup_by_phandle(pdev->dev.of_node,
|
||||||
|
"amlogic,ao-sysctrl");
|
||||||
|
if (IS_ERR(regmap_ao)) {
|
||||||
|
dev_err(&pdev->dev, "failed to get AO regmap\n");
|
||||||
|
return PTR_ERR(regmap_ao);
|
||||||
|
}
|
||||||
|
|
||||||
|
pwrc->regmap_ao = regmap_ao;
|
||||||
|
pwrc->regmap_hhi = regmap_hhi;
|
||||||
|
|
||||||
|
platform_set_drvdata(pdev, pwrc);
|
||||||
|
|
||||||
|
for (i = 0 ; i < match->count ; ++i) {
|
||||||
|
struct meson_ee_pwrc_domain *dom = &pwrc->domains[i];
|
||||||
|
|
||||||
|
memcpy(&dom->desc, &match->domains[i], sizeof(dom->desc));
|
||||||
|
|
||||||
|
ret = meson_ee_pwrc_init_domain(pdev, pwrc, dom);
|
||||||
|
if (ret)
|
||||||
|
return ret;
|
||||||
|
|
||||||
|
pwrc->xlate.domains[i] = &dom->base;
|
||||||
|
}
|
||||||
|
|
||||||
|
of_genpd_add_provider_onecell(pdev->dev.of_node, &pwrc->xlate);
|
||||||
|
|
||||||
|
return 0;
|
||||||
|
}
|
||||||
|
|
||||||
|
static void meson_ee_pwrc_shutdown(struct platform_device *pdev)
|
||||||
|
{
|
||||||
|
struct meson_ee_pwrc *pwrc = platform_get_drvdata(pdev);
|
||||||
|
int i;
|
||||||
|
|
||||||
|
for (i = 0 ; i < pwrc->xlate.num_domains ; ++i) {
|
||||||
|
struct meson_ee_pwrc_domain *dom = &pwrc->domains[i];
|
||||||
|
|
||||||
|
if (dom->desc.get_power && !dom->desc.get_power(dom))
|
||||||
|
meson_ee_pwrc_off(&dom->base);
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_domain_data meson_ee_g12a_pwrc_data = {
|
||||||
|
.count = ARRAY_SIZE(g12a_pwrc_domains),
|
||||||
|
.domains = g12a_pwrc_domains,
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct meson_ee_pwrc_domain_data meson_ee_sm1_pwrc_data = {
|
||||||
|
.count = ARRAY_SIZE(sm1_pwrc_domains),
|
||||||
|
.domains = sm1_pwrc_domains,
|
||||||
|
};
|
||||||
|
|
||||||
|
static const struct of_device_id meson_ee_pwrc_match_table[] = {
|
||||||
|
{
|
||||||
|
.compatible = "amlogic,meson-g12a-pwrc",
|
||||||
|
.data = &meson_ee_g12a_pwrc_data,
|
||||||
|
},
|
||||||
|
{
|
||||||
|
.compatible = "amlogic,meson-sm1-pwrc",
|
||||||
|
.data = &meson_ee_sm1_pwrc_data,
|
||||||
|
},
|
||||||
|
{ /* sentinel */ }
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct platform_driver meson_ee_pwrc_driver = {
|
||||||
|
.probe = meson_ee_pwrc_probe,
|
||||||
|
.shutdown = meson_ee_pwrc_shutdown,
|
||||||
|
.driver = {
|
||||||
|
.name = "meson_ee_pwrc",
|
||||||
|
.of_match_table = meson_ee_pwrc_match_table,
|
||||||
|
},
|
||||||
|
};
|
||||||
|
builtin_platform_driver(meson_ee_pwrc_driver);
|
||||||
13
include/dt-bindings/power/meson-g12a-power.h
Normal file
13
include/dt-bindings/power/meson-g12a-power.h
Normal file
@@ -0,0 +1,13 @@
|
|||||||
|
/* SPDX-License-Identifier: (GPL-2.0+ or MIT) */
|
||||||
|
/*
|
||||||
|
* Copyright (c) 2019 BayLibre, SAS
|
||||||
|
* Author: Neil Armstrong <narmstrong@baylibre.com>
|
||||||
|
*/
|
||||||
|
|
||||||
|
#ifndef _DT_BINDINGS_MESON_G12A_POWER_H
|
||||||
|
#define _DT_BINDINGS_MESON_G12A_POWER_H
|
||||||
|
|
||||||
|
#define PWRC_G12A_VPU_ID 0
|
||||||
|
#define PWRC_G12A_ETH_ID 1
|
||||||
|
|
||||||
|
#endif
|
||||||
18
include/dt-bindings/power/meson-sm1-power.h
Normal file
18
include/dt-bindings/power/meson-sm1-power.h
Normal file
@@ -0,0 +1,18 @@
|
|||||||
|
/* SPDX-License-Identifier: (GPL-2.0+ or MIT) */
|
||||||
|
/*
|
||||||
|
* Copyright (c) 2019 BayLibre, SAS
|
||||||
|
* Author: Neil Armstrong <narmstrong@baylibre.com>
|
||||||
|
*/
|
||||||
|
|
||||||
|
#ifndef _DT_BINDINGS_MESON_SM1_POWER_H
|
||||||
|
#define _DT_BINDINGS_MESON_SM1_POWER_H
|
||||||
|
|
||||||
|
#define PWRC_SM1_VPU_ID 0
|
||||||
|
#define PWRC_SM1_NNA_ID 1
|
||||||
|
#define PWRC_SM1_USB_ID 2
|
||||||
|
#define PWRC_SM1_PCIE_ID 3
|
||||||
|
#define PWRC_SM1_GE2D_ID 4
|
||||||
|
#define PWRC_SM1_AUDIO_ID 5
|
||||||
|
#define PWRC_SM1_ETH_ID 6
|
||||||
|
|
||||||
|
#endif
|
||||||
Reference in New Issue
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