ARM: sun5i: a13: Merge common controllers into the common DTSI
Some controllers found in the A13 DTSI actually apply to all of the sun5i family. Move those into the common DTSI so that all SoCs can benefit from it. Acked-by: Chen-Yu Tsai <wens@csie.org> Signed-off-by: Maxime Ripard <maxime.ripard@free-electrons.com>
This commit is contained in:
Maxime Ripard
@@ -52,21 +52,6 @@
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/ {
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/ {
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interrupt-parent = <&intc>;
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interrupt-parent = <&intc>;
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chosen {
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#address-cells = <1>;
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#size-cells = <1>;
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ranges;
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framebuffer@0 {
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compatible = "allwinner,simple-framebuffer",
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"simple-framebuffer";
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allwinner,pipeline = "de_be0-lcd0";
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clocks = <&ccu CLK_AHB_LCD>, <&ccu CLK_AHB_DE_BE>, <&ccu CLK_DE_BE>,
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<&ccu CLK_TCON_CH0>, <&ccu CLK_DRAM_DE_BE>;
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status = "disabled";
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};
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};
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thermal-zones {
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thermal-zones {
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cpu_thermal {
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cpu_thermal {
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/* milliseconds */
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/* milliseconds */
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@@ -105,44 +90,6 @@
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};
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};
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soc@01c00000 {
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soc@01c00000 {
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tcon0: lcd-controller@01c0c000 {
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||||||
compatible = "allwinner,sun5i-a13-tcon";
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reg = <0x01c0c000 0x1000>;
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interrupts = <44>;
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resets = <&ccu RST_LCD>;
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reset-names = "lcd";
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clocks = <&ccu CLK_AHB_LCD>,
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<&ccu CLK_TCON_CH0>,
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<&ccu CLK_TCON_CH1>;
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clock-names = "ahb",
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"tcon-ch0",
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"tcon-ch1";
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clock-output-names = "tcon-pixel-clock";
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status = "disabled";
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ports {
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#address-cells = <1>;
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#size-cells = <0>;
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tcon0_in: port@0 {
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#address-cells = <1>;
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||||||
#size-cells = <0>;
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reg = <0>;
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||||||
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tcon0_in_be0: endpoint@0 {
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reg = <0>;
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remote-endpoint = <&be0_out_tcon0>;
|
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};
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};
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tcon0_out: port@1 {
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#address-cells = <1>;
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||||||
#size-cells = <0>;
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||||||
reg = <1>;
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};
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||||||
};
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||||||
};
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pwm: pwm@01c20e00 {
|
pwm: pwm@01c20e00 {
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||||||
compatible = "allwinner,sun5i-a13-pwm";
|
compatible = "allwinner,sun5i-a13-pwm";
|
||||||
reg = <0x01c20e00 0xc>;
|
reg = <0x01c20e00 0xc>;
|
||||||
@@ -151,74 +98,6 @@
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|||||||
status = "disabled";
|
status = "disabled";
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||||||
};
|
};
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||||||
|
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||||||
fe0: display-frontend@01e00000 {
|
|
||||||
compatible = "allwinner,sun5i-a13-display-frontend";
|
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||||||
reg = <0x01e00000 0x20000>;
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||||||
interrupts = <47>;
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||||||
clocks = <&ccu CLK_DE_FE>, <&ccu CLK_DE_FE>,
|
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||||||
<&ccu CLK_DRAM_DE_FE>;
|
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||||||
clock-names = "ahb", "mod",
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"ram";
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resets = <&ccu RST_DE_FE>;
|
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||||||
status = "disabled";
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ports {
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||||||
#address-cells = <1>;
|
|
||||||
#size-cells = <0>;
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||||||
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||||||
fe0_out: port@1 {
|
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||||||
#address-cells = <1>;
|
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||||||
#size-cells = <0>;
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||||||
reg = <1>;
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||||||
|
|
||||||
fe0_out_be0: endpoint@0 {
|
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||||||
reg = <0>;
|
|
||||||
remote-endpoint = <&be0_in_fe0>;
|
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||||||
};
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||||||
};
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|
||||||
};
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||||||
};
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||||||
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be0: display-backend@01e60000 {
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||||||
compatible = "allwinner,sun5i-a13-display-backend";
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||||||
reg = <0x01e60000 0x10000>;
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||||||
clocks = <&ccu CLK_AHB_DE_BE>, <&ccu CLK_DE_BE>,
|
|
||||||
<&ccu CLK_DRAM_DE_BE>;
|
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||||||
clock-names = "ahb", "mod",
|
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"ram";
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||||||
resets = <&ccu RST_DE_BE>;
|
|
||||||
status = "disabled";
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||||||
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||||||
assigned-clocks = <&ccu CLK_DE_BE>;
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||||||
assigned-clock-rates = <300000000>;
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ports {
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||||||
#address-cells = <1>;
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||||||
#size-cells = <0>;
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||||||
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||||||
be0_in: port@0 {
|
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||||||
#address-cells = <1>;
|
|
||||||
#size-cells = <0>;
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||||||
reg = <0>;
|
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||||||
|
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||||||
be0_in_fe0: endpoint@0 {
|
|
||||||
reg = <0>;
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||||||
remote-endpoint = <&fe0_out_be0>;
|
|
||||||
};
|
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||||||
};
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||||||
|
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||||||
be0_out: port@1 {
|
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||||||
#address-cells = <1>;
|
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||||||
#size-cells = <0>;
|
|
||||||
reg = <1>;
|
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||||||
|
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||||||
be0_out_tcon0: endpoint@0 {
|
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||||||
reg = <0>;
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|
||||||
remote-endpoint = <&tcon0_in_be0>;
|
|
||||||
};
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||||||
};
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||||||
};
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||||||
};
|
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||||||
};
|
};
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||||||
};
|
};
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||||||
|
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||||||
@@ -244,22 +123,4 @@
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|||||||
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||||||
&pio {
|
&pio {
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||||||
compatible = "allwinner,sun5i-a13-pinctrl";
|
compatible = "allwinner,sun5i-a13-pinctrl";
|
||||||
|
|
||||||
lcd_rgb666_pins: lcd_rgb666@0 {
|
|
||||||
pins = "PD2", "PD3", "PD4", "PD5", "PD6", "PD7",
|
|
||||||
"PD10", "PD11", "PD12", "PD13", "PD14", "PD15",
|
|
||||||
"PD18", "PD19", "PD20", "PD21", "PD22", "PD23",
|
|
||||||
"PD24", "PD25", "PD26", "PD27";
|
|
||||||
function = "lcd0";
|
|
||||||
};
|
|
||||||
|
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||||||
uart1_pins_a: uart1@0 {
|
|
||||||
pins = "PE10", "PE11";
|
|
||||||
function = "uart1";
|
|
||||||
};
|
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||||||
|
|
||||||
uart1_pins_b: uart1@1 {
|
|
||||||
pins = "PG3", "PG4";
|
|
||||||
function = "uart1";
|
|
||||||
};
|
|
||||||
};
|
};
|
||||||
|
|||||||
@@ -64,6 +64,21 @@
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|||||||
};
|
};
|
||||||
};
|
};
|
||||||
|
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||||||
|
chosen {
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|
#address-cells = <1>;
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||||||
|
#size-cells = <1>;
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||||||
|
ranges;
|
||||||
|
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||||||
|
framebuffer@0 {
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||||||
|
compatible = "allwinner,simple-framebuffer",
|
||||||
|
"simple-framebuffer";
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||||||
|
allwinner,pipeline = "de_be0-lcd0";
|
||||||
|
clocks = <&ccu CLK_AHB_LCD>, <&ccu CLK_AHB_DE_BE>, <&ccu CLK_DE_BE>,
|
||||||
|
<&ccu CLK_TCON_CH0>, <&ccu CLK_DRAM_DE_BE>;
|
||||||
|
status = "disabled";
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
clocks {
|
clocks {
|
||||||
#address-cells = <1>;
|
#address-cells = <1>;
|
||||||
#size-cells = <1>;
|
#size-cells = <1>;
|
||||||
@@ -156,6 +171,44 @@
|
|||||||
#size-cells = <0>;
|
#size-cells = <0>;
|
||||||
};
|
};
|
||||||
|
|
||||||
|
tcon0: lcd-controller@01c0c000 {
|
||||||
|
compatible = "allwinner,sun5i-a13-tcon";
|
||||||
|
reg = <0x01c0c000 0x1000>;
|
||||||
|
interrupts = <44>;
|
||||||
|
resets = <&ccu RST_LCD>;
|
||||||
|
reset-names = "lcd";
|
||||||
|
clocks = <&ccu CLK_AHB_LCD>,
|
||||||
|
<&ccu CLK_TCON_CH0>,
|
||||||
|
<&ccu CLK_TCON_CH1>;
|
||||||
|
clock-names = "ahb",
|
||||||
|
"tcon-ch0",
|
||||||
|
"tcon-ch1";
|
||||||
|
clock-output-names = "tcon-pixel-clock";
|
||||||
|
status = "disabled";
|
||||||
|
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||||||
|
ports {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
|
||||||
|
tcon0_in: port@0 {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
reg = <0>;
|
||||||
|
|
||||||
|
tcon0_in_be0: endpoint@0 {
|
||||||
|
reg = <0>;
|
||||||
|
remote-endpoint = <&be0_out_tcon0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
tcon0_out: port@1 {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
reg = <1>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
mmc0: mmc@01c0f000 {
|
mmc0: mmc@01c0f000 {
|
||||||
compatible = "allwinner,sun5i-a13-mmc";
|
compatible = "allwinner,sun5i-a13-mmc";
|
||||||
reg = <0x01c0f000 0x1000>;
|
reg = <0x01c0f000 0x1000>;
|
||||||
@@ -296,6 +349,14 @@
|
|||||||
function = "lcd0";
|
function = "lcd0";
|
||||||
};
|
};
|
||||||
|
|
||||||
|
lcd_rgb666_pins: lcd_rgb666@0 {
|
||||||
|
pins = "PD2", "PD3", "PD4", "PD5", "PD6", "PD7",
|
||||||
|
"PD10", "PD11", "PD12", "PD13", "PD14", "PD15",
|
||||||
|
"PD18", "PD19", "PD20", "PD21", "PD22", "PD23",
|
||||||
|
"PD24", "PD25", "PD26", "PD27";
|
||||||
|
function = "lcd0";
|
||||||
|
};
|
||||||
|
|
||||||
mmc0_pins_a: mmc0@0 {
|
mmc0_pins_a: mmc0@0 {
|
||||||
pins = "PF0", "PF1", "PF2", "PF3",
|
pins = "PF0", "PF1", "PF2", "PF3",
|
||||||
"PF4", "PF5";
|
"PF4", "PF5";
|
||||||
@@ -331,6 +392,16 @@
|
|||||||
function = "spi2";
|
function = "spi2";
|
||||||
};
|
};
|
||||||
|
|
||||||
|
uart1_pins_a: uart1@0 {
|
||||||
|
pins = "PE10", "PE11";
|
||||||
|
function = "uart1";
|
||||||
|
};
|
||||||
|
|
||||||
|
uart1_pins_b: uart1@1 {
|
||||||
|
pins = "PG3", "PG4";
|
||||||
|
function = "uart1";
|
||||||
|
};
|
||||||
|
|
||||||
uart2_pins_a: uart2@0 {
|
uart2_pins_a: uart2@0 {
|
||||||
pins = "PD2", "PD3";
|
pins = "PD2", "PD3";
|
||||||
function = "uart2";
|
function = "uart2";
|
||||||
@@ -457,5 +528,74 @@
|
|||||||
interrupts = <82>, <83>;
|
interrupts = <82>, <83>;
|
||||||
clocks = <&ccu CLK_AHB_HSTIMER>;
|
clocks = <&ccu CLK_AHB_HSTIMER>;
|
||||||
};
|
};
|
||||||
|
|
||||||
|
fe0: display-frontend@01e00000 {
|
||||||
|
compatible = "allwinner,sun5i-a13-display-frontend";
|
||||||
|
reg = <0x01e00000 0x20000>;
|
||||||
|
interrupts = <47>;
|
||||||
|
clocks = <&ccu CLK_DE_FE>, <&ccu CLK_DE_FE>,
|
||||||
|
<&ccu CLK_DRAM_DE_FE>;
|
||||||
|
clock-names = "ahb", "mod",
|
||||||
|
"ram";
|
||||||
|
resets = <&ccu RST_DE_FE>;
|
||||||
|
status = "disabled";
|
||||||
|
|
||||||
|
ports {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
|
||||||
|
fe0_out: port@1 {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
reg = <1>;
|
||||||
|
|
||||||
|
fe0_out_be0: endpoint@0 {
|
||||||
|
reg = <0>;
|
||||||
|
remote-endpoint = <&be0_in_fe0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
be0: display-backend@01e60000 {
|
||||||
|
compatible = "allwinner,sun5i-a13-display-backend";
|
||||||
|
reg = <0x01e60000 0x10000>;
|
||||||
|
clocks = <&ccu CLK_AHB_DE_BE>, <&ccu CLK_DE_BE>,
|
||||||
|
<&ccu CLK_DRAM_DE_BE>;
|
||||||
|
clock-names = "ahb", "mod",
|
||||||
|
"ram";
|
||||||
|
resets = <&ccu RST_DE_BE>;
|
||||||
|
status = "disabled";
|
||||||
|
|
||||||
|
assigned-clocks = <&ccu CLK_DE_BE>;
|
||||||
|
assigned-clock-rates = <300000000>;
|
||||||
|
|
||||||
|
ports {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
|
||||||
|
be0_in: port@0 {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
reg = <0>;
|
||||||
|
|
||||||
|
be0_in_fe0: endpoint@0 {
|
||||||
|
reg = <0>;
|
||||||
|
remote-endpoint = <&fe0_out_be0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
be0_out: port@1 {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
reg = <1>;
|
||||||
|
|
||||||
|
be0_out_tcon0: endpoint@0 {
|
||||||
|
reg = <0>;
|
||||||
|
remote-endpoint = <&tcon0_in_be0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
};
|
};
|
||||||
};
|
};
|
||||||
|
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