mxser: convert large macros to functions
Signed-off-by: Christoph Hellwig <hch@lst.de> Signed-off-by: Jiri Slaby <jirislaby@gmail.com> Signed-off-by: Andrew Morton <akpm@linux-foundation.org> Signed-off-by: Linus Torvalds <torvalds@linux-foundation.org>
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Linus Torvalds
Linus Torvalds
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12a3de0a96
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148ff86b11
@@ -147,141 +147,4 @@
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/* Rx software flow control mask */
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#define MOXA_MUST_EFR_SF_RX_MASK 0x03
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#define ENABLE_MOXA_MUST_ENCHANCE_MODE(baseio) do { \
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u8 __oldlcr, __efr; \
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__oldlcr = inb((baseio)+UART_LCR); \
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outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
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__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
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__efr |= MOXA_MUST_EFR_EFRB_ENABLE; \
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outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
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||||
outb(__oldlcr, (baseio)+UART_LCR); \
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} while (0)
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#define DISABLE_MOXA_MUST_ENCHANCE_MODE(baseio) do { \
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u8 __oldlcr, __efr; \
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__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_EFRB_ENABLE; \
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||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
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||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
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#define SET_MOXA_MUST_XON1_VALUE(baseio, Value) do { \
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u8 __oldlcr, __efr; \
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||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_BANK_MASK; \
|
||||
__efr |= MOXA_MUST_EFR_BANK0; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
outb((u8)(Value), (baseio)+MOXA_MUST_XON1_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
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#define SET_MOXA_MUST_XOFF1_VALUE(baseio, Value) do { \
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||||
u8 __oldlcr, __efr; \
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||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_BANK_MASK; \
|
||||
__efr |= MOXA_MUST_EFR_BANK0; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
outb((u8)(Value), (baseio)+MOXA_MUST_XOFF1_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
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||||
#define SET_MOXA_MUST_FIFO_VALUE(info) do { \
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u8 __oldlcr, __efr; \
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||||
__oldlcr = inb((info)->ioaddr+UART_LCR); \
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||||
outb(MOXA_MUST_ENTER_ENCHANCE, (info)->ioaddr+UART_LCR);\
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||||
__efr = inb((info)->ioaddr+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_BANK_MASK; \
|
||||
__efr |= MOXA_MUST_EFR_BANK1; \
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||||
outb(__efr, (info)->ioaddr+MOXA_MUST_EFR_REGISTER); \
|
||||
outb((u8)((info)->rx_high_water), (info)->ioaddr+ \
|
||||
MOXA_MUST_RBRTH_REGISTER); \
|
||||
outb((u8)((info)->rx_trigger), (info)->ioaddr+ \
|
||||
MOXA_MUST_RBRTI_REGISTER); \
|
||||
outb((u8)((info)->rx_low_water), (info)->ioaddr+ \
|
||||
MOXA_MUST_RBRTL_REGISTER); \
|
||||
outb(__oldlcr, (info)->ioaddr+UART_LCR); \
|
||||
} while (0)
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#define SET_MOXA_MUST_ENUM_VALUE(baseio, Value) do { \
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||||
u8 __oldlcr, __efr; \
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||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_BANK_MASK; \
|
||||
__efr |= MOXA_MUST_EFR_BANK2; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
outb((u8)(Value), (baseio)+MOXA_MUST_ENUM_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
|
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||||
#define GET_MOXA_MUST_HARDWARE_ID(baseio, pId) do { \
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||||
u8 __oldlcr, __efr; \
|
||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_BANK_MASK; \
|
||||
__efr |= MOXA_MUST_EFR_BANK2; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
*pId = inb((baseio)+MOXA_MUST_HWID_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
|
||||
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||||
#define SET_MOXA_MUST_NO_SOFTWARE_FLOW_CONTROL(baseio) do { \
|
||||
u8 __oldlcr, __efr; \
|
||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_SF_MASK; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
|
||||
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||||
#define ENABLE_MOXA_MUST_TX_SOFTWARE_FLOW_CONTROL(baseio) do { \
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||||
u8 __oldlcr, __efr; \
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||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_SF_TX_MASK; \
|
||||
__efr |= MOXA_MUST_EFR_SF_TX1; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
|
||||
|
||||
#define DISABLE_MOXA_MUST_TX_SOFTWARE_FLOW_CONTROL(baseio) do { \
|
||||
u8 __oldlcr, __efr; \
|
||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_SF_TX_MASK; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
|
||||
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||||
#define ENABLE_MOXA_MUST_RX_SOFTWARE_FLOW_CONTROL(baseio) do { \
|
||||
u8 __oldlcr, __efr; \
|
||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_SF_RX_MASK; \
|
||||
__efr |= MOXA_MUST_EFR_SF_RX1; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
|
||||
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||||
#define DISABLE_MOXA_MUST_RX_SOFTWARE_FLOW_CONTROL(baseio) do { \
|
||||
u8 __oldlcr, __efr; \
|
||||
__oldlcr = inb((baseio)+UART_LCR); \
|
||||
outb(MOXA_MUST_ENTER_ENCHANCE, (baseio)+UART_LCR); \
|
||||
__efr = inb((baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
__efr &= ~MOXA_MUST_EFR_SF_RX_MASK; \
|
||||
outb(__efr, (baseio)+MOXA_MUST_EFR_REGISTER); \
|
||||
outb(__oldlcr, (baseio)+UART_LCR); \
|
||||
} while (0)
|
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#endif
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