qcom,gcc-msm8974.h 12 KB

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  1. /* SPDX-License-Identifier: GPL-2.0-only */
  2. /*
  3. * Copyright (c) 2013, The Linux Foundation. All rights reserved.
  4. */
  5. #ifndef _DT_BINDINGS_CLK_MSM_GCC_8974_H
  6. #define _DT_BINDINGS_CLK_MSM_GCC_8974_H
  7. #define GPLL0 0
  8. #define GPLL0_VOTE 1
  9. #define CONFIG_NOC_CLK_SRC 2
  10. #define GPLL2 3
  11. #define GPLL2_VOTE 4
  12. #define GPLL3 5
  13. #define GPLL3_VOTE 6
  14. #define PERIPH_NOC_CLK_SRC 7
  15. #define BLSP_UART_SIM_CLK_SRC 8
  16. #define QDSS_TSCTR_CLK_SRC 9
  17. #define BIMC_DDR_CLK_SRC 10
  18. #define SYSTEM_NOC_CLK_SRC 11
  19. #define GPLL1 12
  20. #define GPLL1_VOTE 13
  21. #define RPM_CLK_SRC 14
  22. #define GCC_BIMC_CLK 15
  23. #define BIMC_DDR_CPLL0_ROOT_CLK_SRC 16
  24. #define KPSS_AHB_CLK_SRC 17
  25. #define QDSS_AT_CLK_SRC 18
  26. #define USB30_MASTER_CLK_SRC 19
  27. #define BIMC_DDR_CPLL1_ROOT_CLK_SRC 20
  28. #define QDSS_STM_CLK_SRC 21
  29. #define ACC_CLK_SRC 22
  30. #define SEC_CTRL_CLK_SRC 23
  31. #define BLSP1_QUP1_I2C_APPS_CLK_SRC 24
  32. #define BLSP1_QUP1_SPI_APPS_CLK_SRC 25
  33. #define BLSP1_QUP2_I2C_APPS_CLK_SRC 26
  34. #define BLSP1_QUP2_SPI_APPS_CLK_SRC 27
  35. #define BLSP1_QUP3_I2C_APPS_CLK_SRC 28
  36. #define BLSP1_QUP3_SPI_APPS_CLK_SRC 29
  37. #define BLSP1_QUP4_I2C_APPS_CLK_SRC 30
  38. #define BLSP1_QUP4_SPI_APPS_CLK_SRC 31
  39. #define BLSP1_QUP5_I2C_APPS_CLK_SRC 32
  40. #define BLSP1_QUP5_SPI_APPS_CLK_SRC 33
  41. #define BLSP1_QUP6_I2C_APPS_CLK_SRC 34
  42. #define BLSP1_QUP6_SPI_APPS_CLK_SRC 35
  43. #define BLSP1_UART1_APPS_CLK_SRC 36
  44. #define BLSP1_UART2_APPS_CLK_SRC 37
  45. #define BLSP1_UART3_APPS_CLK_SRC 38
  46. #define BLSP1_UART4_APPS_CLK_SRC 39
  47. #define BLSP1_UART5_APPS_CLK_SRC 40
  48. #define BLSP1_UART6_APPS_CLK_SRC 41
  49. #define BLSP2_QUP1_I2C_APPS_CLK_SRC 42
  50. #define BLSP2_QUP1_SPI_APPS_CLK_SRC 43
  51. #define BLSP2_QUP2_I2C_APPS_CLK_SRC 44
  52. #define BLSP2_QUP2_SPI_APPS_CLK_SRC 45
  53. #define BLSP2_QUP3_I2C_APPS_CLK_SRC 46
  54. #define BLSP2_QUP3_SPI_APPS_CLK_SRC 47
  55. #define BLSP2_QUP4_I2C_APPS_CLK_SRC 48
  56. #define BLSP2_QUP4_SPI_APPS_CLK_SRC 49
  57. #define BLSP2_QUP5_I2C_APPS_CLK_SRC 50
  58. #define BLSP2_QUP5_SPI_APPS_CLK_SRC 51
  59. #define BLSP2_QUP6_I2C_APPS_CLK_SRC 52
  60. #define BLSP2_QUP6_SPI_APPS_CLK_SRC 53
  61. #define BLSP2_UART1_APPS_CLK_SRC 54
  62. #define BLSP2_UART2_APPS_CLK_SRC 55
  63. #define BLSP2_UART3_APPS_CLK_SRC 56
  64. #define BLSP2_UART4_APPS_CLK_SRC 57
  65. #define BLSP2_UART5_APPS_CLK_SRC 58
  66. #define BLSP2_UART6_APPS_CLK_SRC 59
  67. #define CE1_CLK_SRC 60
  68. #define CE2_CLK_SRC 61
  69. #define GP1_CLK_SRC 62
  70. #define GP2_CLK_SRC 63
  71. #define GP3_CLK_SRC 64
  72. #define PDM2_CLK_SRC 65
  73. #define QDSS_TRACECLKIN_CLK_SRC 66
  74. #define RBCPR_CLK_SRC 67
  75. #define SDCC1_APPS_CLK_SRC 68
  76. #define SDCC2_APPS_CLK_SRC 69
  77. #define SDCC3_APPS_CLK_SRC 70
  78. #define SDCC4_APPS_CLK_SRC 71
  79. #define SPMI_AHB_CLK_SRC 72
  80. #define SPMI_SER_CLK_SRC 73
  81. #define TSIF_REF_CLK_SRC 74
  82. #define USB30_MOCK_UTMI_CLK_SRC 75
  83. #define USB_HS_SYSTEM_CLK_SRC 76
  84. #define USB_HSIC_CLK_SRC 77
  85. #define USB_HSIC_IO_CAL_CLK_SRC 78
  86. #define USB_HSIC_SYSTEM_CLK_SRC 79
  87. #define GCC_BAM_DMA_AHB_CLK 80
  88. #define GCC_BAM_DMA_INACTIVITY_TIMERS_CLK 81
  89. #define GCC_BIMC_CFG_AHB_CLK 82
  90. #define GCC_BIMC_KPSS_AXI_CLK 83
  91. #define GCC_BIMC_SLEEP_CLK 84
  92. #define GCC_BIMC_SYSNOC_AXI_CLK 85
  93. #define GCC_BIMC_XO_CLK 86
  94. #define GCC_BLSP1_AHB_CLK 87
  95. #define GCC_BLSP1_SLEEP_CLK 88
  96. #define GCC_BLSP1_QUP1_I2C_APPS_CLK 89
  97. #define GCC_BLSP1_QUP1_SPI_APPS_CLK 90
  98. #define GCC_BLSP1_QUP2_I2C_APPS_CLK 91
  99. #define GCC_BLSP1_QUP2_SPI_APPS_CLK 92
  100. #define GCC_BLSP1_QUP3_I2C_APPS_CLK 93
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  102. #define GCC_BLSP1_QUP4_I2C_APPS_CLK 95
  103. #define GCC_BLSP1_QUP4_SPI_APPS_CLK 96
  104. #define GCC_BLSP1_QUP5_I2C_APPS_CLK 97
  105. #define GCC_BLSP1_QUP5_SPI_APPS_CLK 98
  106. #define GCC_BLSP1_QUP6_I2C_APPS_CLK 99
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  108. #define GCC_BLSP1_UART1_APPS_CLK 101
  109. #define GCC_BLSP1_UART1_SIM_CLK 102
  110. #define GCC_BLSP1_UART2_APPS_CLK 103
  111. #define GCC_BLSP1_UART2_SIM_CLK 104
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  113. #define GCC_BLSP1_UART3_SIM_CLK 106
  114. #define GCC_BLSP1_UART4_APPS_CLK 107
  115. #define GCC_BLSP1_UART4_SIM_CLK 108
  116. #define GCC_BLSP1_UART5_APPS_CLK 109
  117. #define GCC_BLSP1_UART5_SIM_CLK 110
  118. #define GCC_BLSP1_UART6_APPS_CLK 111
  119. #define GCC_BLSP1_UART6_SIM_CLK 112
  120. #define GCC_BLSP2_AHB_CLK 113
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  122. #define GCC_BLSP2_QUP1_I2C_APPS_CLK 115
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  124. #define GCC_BLSP2_QUP2_I2C_APPS_CLK 117
  125. #define GCC_BLSP2_QUP2_SPI_APPS_CLK 118
  126. #define GCC_BLSP2_QUP3_I2C_APPS_CLK 119
  127. #define GCC_BLSP2_QUP3_SPI_APPS_CLK 120
  128. #define GCC_BLSP2_QUP4_I2C_APPS_CLK 121
  129. #define GCC_BLSP2_QUP4_SPI_APPS_CLK 122
  130. #define GCC_BLSP2_QUP5_I2C_APPS_CLK 123
  131. #define GCC_BLSP2_QUP5_SPI_APPS_CLK 124
  132. #define GCC_BLSP2_QUP6_I2C_APPS_CLK 125
  133. #define GCC_BLSP2_QUP6_SPI_APPS_CLK 126
  134. #define GCC_BLSP2_UART1_APPS_CLK 127
  135. #define GCC_BLSP2_UART1_SIM_CLK 128
  136. #define GCC_BLSP2_UART2_APPS_CLK 129
  137. #define GCC_BLSP2_UART2_SIM_CLK 130
  138. #define GCC_BLSP2_UART3_APPS_CLK 131
  139. #define GCC_BLSP2_UART3_SIM_CLK 132
  140. #define GCC_BLSP2_UART4_APPS_CLK 133
  141. #define GCC_BLSP2_UART4_SIM_CLK 134
  142. #define GCC_BLSP2_UART5_APPS_CLK 135
  143. #define GCC_BLSP2_UART5_SIM_CLK 136
  144. #define GCC_BLSP2_UART6_APPS_CLK 137
  145. #define GCC_BLSP2_UART6_SIM_CLK 138
  146. #define GCC_BOOT_ROM_AHB_CLK 139
  147. #define GCC_CE1_AHB_CLK 140
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  149. #define GCC_CE1_CLK 142
  150. #define GCC_CE2_AHB_CLK 143
  151. #define GCC_CE2_AXI_CLK 144
  152. #define GCC_CE2_CLK 145
  153. #define GCC_CNOC_BUS_TIMEOUT0_AHB_CLK 146
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  158. #define GCC_CNOC_BUS_TIMEOUT5_AHB_CLK 151
  159. #define GCC_CNOC_BUS_TIMEOUT6_AHB_CLK 152
  160. #define GCC_CFG_NOC_AHB_CLK 153
  161. #define GCC_CFG_NOC_DDR_CFG_CLK 154
  162. #define GCC_CFG_NOC_RPM_AHB_CLK 155
  163. #define GCC_BIMC_DDR_CPLL0_CLK 156
  164. #define GCC_BIMC_DDR_CPLL1_CLK 157
  165. #define GCC_DDR_DIM_CFG_CLK 158
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  171. #define GCC_XO_DIV4_CLK 164
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  175. #define GCC_IMEM_AXI_CLK 168
  176. #define GCC_IMEM_CFG_AHB_CLK 169
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  180. #define GCC_MMSS_NOC_AT_CLK 173
  181. #define GCC_MMSS_NOC_CFG_AHB_CLK 174
  182. #define GCC_OCMEM_NOC_CFG_AHB_CLK 175
  183. #define GCC_OCMEM_SYS_NOC_AXI_CLK 176
  184. #define GCC_MPM_AHB_CLK 177
  185. #define GCC_MSG_RAM_AHB_CLK 178
  186. #define GCC_MSS_CFG_AHB_CLK 179
  187. #define GCC_MSS_Q6_BIMC_AXI_CLK 180
  188. #define GCC_NOC_CONF_XPU_AHB_CLK 181
  189. #define GCC_PDM2_CLK 182
  190. #define GCC_PDM_AHB_CLK 183
  191. #define GCC_PDM_XO4_CLK 184
  192. #define GCC_PERIPH_NOC_AHB_CLK 185
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  194. #define GCC_PERIPH_NOC_CFG_AHB_CLK 187
  195. #define GCC_PERIPH_NOC_MPU_CFG_AHB_CLK 188
  196. #define GCC_PERIPH_XPU_AHB_CLK 189
  197. #define GCC_PNOC_BUS_TIMEOUT0_AHB_CLK 190
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  202. #define GCC_PRNG_AHB_CLK 195
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  204. #define GCC_QDSS_CFG_AHB_CLK 197
  205. #define GCC_QDSS_DAP_AHB_CLK 198
  206. #define GCC_QDSS_DAP_CLK 199
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  209. #define GCC_QDSS_TRACECLKIN_CLK 202
  210. #define GCC_QDSS_TSCTR_DIV16_CLK 203
  211. #define GCC_QDSS_TSCTR_DIV2_CLK 204
  212. #define GCC_QDSS_TSCTR_DIV3_CLK 205
  213. #define GCC_QDSS_TSCTR_DIV4_CLK 206
  214. #define GCC_QDSS_TSCTR_DIV8_CLK 207
  215. #define GCC_QDSS_RBCPR_XPU_AHB_CLK 208
  216. #define GCC_RBCPR_AHB_CLK 209
  217. #define GCC_RBCPR_CLK 210
  218. #define GCC_RPM_BUS_AHB_CLK 211
  219. #define GCC_RPM_PROC_HCLK 212
  220. #define GCC_RPM_SLEEP_CLK 213
  221. #define GCC_RPM_TIMER_CLK 214
  222. #define GCC_SDCC1_AHB_CLK 215
  223. #define GCC_SDCC1_APPS_CLK 216
  224. #define GCC_SDCC1_INACTIVITY_TIMERS_CLK 217
  225. #define GCC_SDCC2_AHB_CLK 218
  226. #define GCC_SDCC2_APPS_CLK 219
  227. #define GCC_SDCC2_INACTIVITY_TIMERS_CLK 220
  228. #define GCC_SDCC3_AHB_CLK 221
  229. #define GCC_SDCC3_APPS_CLK 222
  230. #define GCC_SDCC3_INACTIVITY_TIMERS_CLK 223
  231. #define GCC_SDCC4_AHB_CLK 224
  232. #define GCC_SDCC4_APPS_CLK 225
  233. #define GCC_SDCC4_INACTIVITY_TIMERS_CLK 226
  234. #define GCC_SEC_CTRL_ACC_CLK 227
  235. #define GCC_SEC_CTRL_AHB_CLK 228
  236. #define GCC_SEC_CTRL_BOOT_ROM_PATCH_CLK 229
  237. #define GCC_SEC_CTRL_CLK 230
  238. #define GCC_SEC_CTRL_SENSE_CLK 231
  239. #define GCC_SNOC_BUS_TIMEOUT0_AHB_CLK 232
  240. #define GCC_SNOC_BUS_TIMEOUT2_AHB_CLK 233
  241. #define GCC_SPDM_BIMC_CY_CLK 234
  242. #define GCC_SPDM_CFG_AHB_CLK 235
  243. #define GCC_SPDM_DEBUG_CY_CLK 236
  244. #define GCC_SPDM_FF_CLK 237
  245. #define GCC_SPDM_MSTR_AHB_CLK 238
  246. #define GCC_SPDM_PNOC_CY_CLK 239
  247. #define GCC_SPDM_RPM_CY_CLK 240
  248. #define GCC_SPDM_SNOC_CY_CLK 241
  249. #define GCC_SPMI_AHB_CLK 242
  250. #define GCC_SPMI_CNOC_AHB_CLK 243
  251. #define GCC_SPMI_SER_CLK 244
  252. #define GCC_SNOC_CNOC_AHB_CLK 245
  253. #define GCC_SNOC_PNOC_AHB_CLK 246
  254. #define GCC_SYS_NOC_AT_CLK 247
  255. #define GCC_SYS_NOC_AXI_CLK 248
  256. #define GCC_SYS_NOC_KPSS_AHB_CLK 249
  257. #define GCC_SYS_NOC_QDSS_STM_AXI_CLK 250
  258. #define GCC_SYS_NOC_USB3_AXI_CLK 251
  259. #define GCC_TCSR_AHB_CLK 252
  260. #define GCC_TLMM_AHB_CLK 253
  261. #define GCC_TLMM_CLK 254
  262. #define GCC_TSIF_AHB_CLK 255
  263. #define GCC_TSIF_INACTIVITY_TIMERS_CLK 256
  264. #define GCC_TSIF_REF_CLK 257
  265. #define GCC_USB2A_PHY_SLEEP_CLK 258
  266. #define GCC_USB2B_PHY_SLEEP_CLK 259
  267. #define GCC_USB30_MASTER_CLK 260
  268. #define GCC_USB30_MOCK_UTMI_CLK 261
  269. #define GCC_USB30_SLEEP_CLK 262
  270. #define GCC_USB_HS_AHB_CLK 263
  271. #define GCC_USB_HS_INACTIVITY_TIMERS_CLK 264
  272. #define GCC_USB_HS_SYSTEM_CLK 265
  273. #define GCC_USB_HSIC_AHB_CLK 266
  274. #define GCC_USB_HSIC_CLK 267
  275. #define GCC_USB_HSIC_IO_CAL_CLK 268
  276. #define GCC_USB_HSIC_IO_CAL_SLEEP_CLK 269
  277. #define GCC_USB_HSIC_SYSTEM_CLK 270
  278. #define GCC_WCSS_GPLL1_CLK_SRC 271
  279. #define GCC_MMSS_GPLL0_CLK_SRC 272
  280. #define GCC_LPASS_GPLL0_CLK_SRC 273
  281. #define GCC_WCSS_GPLL1_CLK_SRC_SLEEP_ENA 274
  282. #define GCC_MMSS_GPLL0_CLK_SRC_SLEEP_ENA 275
  283. #define GCC_LPASS_GPLL0_CLK_SRC_SLEEP_ENA 276
  284. #define GCC_IMEM_AXI_CLK_SLEEP_ENA 277
  285. #define GCC_SYS_NOC_KPSS_AHB_CLK_SLEEP_ENA 278
  286. #define GCC_BIMC_KPSS_AXI_CLK_SLEEP_ENA 279
  287. #define GCC_KPSS_AHB_CLK_SLEEP_ENA 280
  288. #define GCC_KPSS_AXI_CLK_SLEEP_ENA 281
  289. #define GCC_MPM_AHB_CLK_SLEEP_ENA 282
  290. #define GCC_OCMEM_SYS_NOC_AXI_CLK_SLEEP_ENA 283
  291. #define GCC_BLSP1_AHB_CLK_SLEEP_ENA 284
  292. #define GCC_BLSP1_SLEEP_CLK_SLEEP_ENA 285
  293. #define GCC_BLSP2_AHB_CLK_SLEEP_ENA 286
  294. #define GCC_BLSP2_SLEEP_CLK_SLEEP_ENA 287
  295. #define GCC_PRNG_AHB_CLK_SLEEP_ENA 288
  296. #define GCC_BAM_DMA_AHB_CLK_SLEEP_ENA 289
  297. #define GCC_BAM_DMA_INACTIVITY_TIMERS_CLK_SLEEP_ENA 290
  298. #define GCC_BOOT_ROM_AHB_CLK_SLEEP_ENA 291
  299. #define GCC_MSG_RAM_AHB_CLK_SLEEP_ENA 292
  300. #define GCC_TLMM_AHB_CLK_SLEEP_ENA 293
  301. #define GCC_TLMM_CLK_SLEEP_ENA 294
  302. #define GCC_SPMI_CNOC_AHB_CLK_SLEEP_ENA 295
  303. #define GCC_CE1_CLK_SLEEP_ENA 296
  304. #define GCC_CE1_AXI_CLK_SLEEP_ENA 297
  305. #define GCC_CE1_AHB_CLK_SLEEP_ENA 298
  306. #define GCC_CE2_CLK_SLEEP_ENA 299
  307. #define GCC_CE2_AXI_CLK_SLEEP_ENA 300
  308. #define GCC_CE2_AHB_CLK_SLEEP_ENA 301
  309. #define GPLL4 302
  310. #define GPLL4_VOTE 303
  311. #define GCC_SDCC1_CDCCAL_SLEEP_CLK 304
  312. #define GCC_SDCC1_CDCCAL_FF_CLK 305
  313. /* gdscs */
  314. #define USB_HS_HSIC_GDSC 0
  315. #endif