android_kernel_samsung_sm8650_ksu/include/dt-bindings/clock/qcom,gcc-lemans.h

/* SPDX-License-Identifier: GPL-2.0-only */
/*
 * Copyright (c) 2022-2023, Qualcomm Innovation Center, Inc. All rights reserved.
 */

#ifndef _DT_BINDINGS_CLK_QCOM_GCC_LEMANS_H
#define _DT_BINDINGS_CLK_QCOM_GCC_LEMANS_H

/* GCC clocks */
#define GCC_GPLL0					0
#define GCC_GPLL0_OUT_EVEN				1
#define GCC_GPLL1					2
#define GCC_GPLL4					3
#define GCC_GPLL5					4
#define GCC_GPLL7					5
#define GCC_GPLL9					6
#define GCC_AGGRE_NOC_QUPV3_AXI_CLK			7
#define GCC_AGGRE_UFS_CARD_AXI_CLK			8
#define GCC_AGGRE_UFS_PHY_AXI_CLK			9
#define GCC_AGGRE_USB2_PRIM_AXI_CLK			10
#define GCC_AGGRE_USB3_PRIM_AXI_CLK			11
#define GCC_AGGRE_USB3_SEC_AXI_CLK			12
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#define GCC_AHB2PHY2_CLK				14
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#define GCC_CAMERA_SF_AXI_CLK				19
#define GCC_CAMERA_THROTTLE_XO_CLK			20
#define GCC_CAMERA_XO_CLK				21
#define GCC_CFG_NOC_USB2_PRIM_AXI_CLK			22
#define GCC_CFG_NOC_USB3_PRIM_AXI_CLK			23
#define GCC_CFG_NOC_USB3_SEC_AXI_CLK			24
#define GCC_DDRSS_GPU_AXI_CLK				25
#define GCC_DISP1_AHB_CLK				26
#define GCC_DISP1_HF_AXI_CLK				27
#define GCC_DISP1_XO_CLK				28
#define GCC_DISP_AHB_CLK				29
#define GCC_DISP_HF_AXI_CLK				30
#define GCC_DISP_XO_CLK					31
#define GCC_EDP_REF_CLKREF_EN				32
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#define GCC_EMAC0_PHY_AUX_CLK				34
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#define GCC_EMAC0_RGMII_CLK_SRC				39
#define GCC_EMAC0_SLV_AHB_CLK				40
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#define GCC_EMAC1_PHY_AUX_CLK				42
#define GCC_EMAC1_PHY_AUX_CLK_SRC			43
#define GCC_EMAC1_PTP_CLK				44
#define GCC_EMAC1_PTP_CLK_SRC				45
#define GCC_EMAC1_RGMII_CLK				46
#define GCC_EMAC1_RGMII_CLK_SRC				47
#define GCC_EMAC1_SLV_AHB_CLK				48
#define GCC_GP1_CLK					49
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#define GCC_PCIE_1_PIPEDIV2_CLK				91
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#define GCC_QMIP_DISP_ROT_AHB_CLK			105
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#define GCC_UFS_CARD_UNIPRO_CORE_CLK_SRC		195
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#define GCC_UFS_PHY_AXI_CLK_SRC				198
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#define GCC_UFS_PHY_ICE_CORE_CLK_SRC			200
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#define GCC_UFS_PHY_PHY_AUX_CLK_SRC			202
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#define GCC_UFS_PHY_RX_SYMBOL_0_CLK_SRC			204
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#define GCC_UFS_PHY_UNIPRO_CORE_CLK			209
#define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC			210
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#define GCC_USB20_MASTER_CLK_SRC			212
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#define GCC_USB30_PRIM_MASTER_CLK_SRC			218
#define GCC_USB30_PRIM_MOCK_UTMI_CLK			219
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#define GCC_USB30_PRIM_MOCK_UTMI_POSTDIV_CLK_SRC	221
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#define GCC_USB30_SEC_MOCK_UTMI_POSTDIV_CLK_SRC		227
#define GCC_USB30_SEC_SLEEP_CLK				228
#define GCC_USB3_PRIM_PHY_AUX_CLK			229
#define GCC_USB3_PRIM_PHY_AUX_CLK_SRC			230
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#define GCC_USB3_PRIM_PHY_PIPE_CLK_SRC			233
#define GCC_USB3_SEC_PHY_AUX_CLK			234
#define GCC_USB3_SEC_PHY_AUX_CLK_SRC			235
#define GCC_USB3_SEC_PHY_COM_AUX_CLK			236
#define GCC_USB3_SEC_PHY_PIPE_CLK			237
#define GCC_USB3_SEC_PHY_PIPE_CLK_SRC			238
#define GCC_USB_CLKREF_EN				239
#define GCC_VIDEO_AHB_CLK				240
#define GCC_VIDEO_AXI0_CLK				241
#define GCC_VIDEO_AXI1_CLK				242
#define GCC_VIDEO_XO_CLK				243
#define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK		244
#define GCC_UFS_PHY_AXI_HW_CTL_CLK			245
#define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK			246
#define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK			247
#define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK		248

/* GCC resets */
#define GCC_EMAC0_BCR					0
#define GCC_EMAC1_BCR					1
#define GCC_PCIE_0_BCR					2
#define GCC_PCIE_0_LINK_DOWN_BCR			3
#define GCC_PCIE_0_NOCSR_COM_PHY_BCR			4
#define GCC_PCIE_0_PHY_BCR				5
#define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR		6
#define GCC_PCIE_1_BCR					7
#define GCC_PCIE_1_LINK_DOWN_BCR			8
#define GCC_PCIE_1_NOCSR_COM_PHY_BCR			9
#define GCC_PCIE_1_PHY_BCR				10
#define GCC_PCIE_1_PHY_NOCSR_COM_PHY_BCR		11
#define GCC_PCIE_RSCC_BCR				12
#define GCC_SDCC1_BCR					13
#define GCC_UFS_CARD_BCR				14
#define GCC_UFS_PHY_BCR					15
#define GCC_USB20_PRIM_BCR				16
#define GCC_USB2_PHY_PRIM_BCR				17
#define GCC_USB2_PHY_SEC_BCR				18
#define GCC_USB30_PRIM_BCR				19
#define GCC_USB30_SEC_BCR				20
#define GCC_USB3_DP_PHY_PRIM_BCR			21
#define GCC_USB3_DP_PHY_SEC_BCR				22
#define GCC_USB3_PHY_PRIM_BCR				23
#define GCC_USB3_PHY_SEC_BCR				24
#define GCC_USB3_PHY_TERT_BCR				25
#define GCC_USB3_UNIPHY_MP0_BCR				26
#define GCC_USB3_UNIPHY_MP1_BCR				27
#define GCC_USB3PHY_PHY_PRIM_BCR			28
#define GCC_USB3PHY_PHY_SEC_BCR				29
#define GCC_USB3UNIPHY_PHY_MP0_BCR			30
#define GCC_USB3UNIPHY_PHY_MP1_BCR			31
#define GCC_USB_PHY_CFG_AHB2PHY_BCR			32
#define GCC_VIDEO_BCR					33
#define GCC_VIDEO_AXI0_CLK_ARES				34
#define GCC_VIDEO_AXI1_CLK_ARES				35

#endif