qcom,gcc-direwolf.h 18 KB

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  1. /* SPDX-License-Identifier: GPL-2.0-only */
  2. /*
  3. * Copyright (c) 2022-2023, Qualcomm Innovation Center, Inc. All rights reserved.
  4. */
  5. #ifndef _DT_BINDINGS_CLK_QCOM_GCC_DIREWOLF_H
  6. #define _DT_BINDINGS_CLK_QCOM_GCC_DIREWOLF_H
  7. /* GCC clocks */
  8. #define GCC_GPLL0 0
  9. #define GCC_GPLL0_OUT_EVEN 1
  10. #define GCC_GPLL2 2
  11. #define GCC_GPLL4 3
  12. #define GCC_GPLL7 4
  13. #define GCC_GPLL8 5
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  15. #define GCC_AGGRE_NOC_PCIE0_TUNNEL_AXI_CLK 7
  16. #define GCC_AGGRE_NOC_PCIE1_TUNNEL_AXI_CLK 8
  17. #define GCC_AGGRE_NOC_PCIE_4_AXI_CLK 9
  18. #define GCC_AGGRE_NOC_PCIE_SOUTH_SF_AXI_CLK 10
  19. #define GCC_AGGRE_UFS_CARD_AXI_CLK 11
  20. #define GCC_AGGRE_UFS_PHY_AXI_CLK 12
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  22. #define GCC_AGGRE_USB3_PRIM_AXI_CLK 14
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  26. #define GCC_AGGRE_USB_NOC_AXI_CLK 18
  27. #define GCC_AGGRE_USB_NOC_NORTH_AXI_CLK 19
  28. #define GCC_AGGRE_USB_NOC_SOUTH_AXI_CLK 20
  29. #define GCC_AHB2PHY0_CLK 21
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  31. #define GCC_BOOT_ROM_AHB_CLK 23
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  36. #define GCC_CAMERA_THROTTLE_RT_AXI_CLK 28
  37. #define GCC_CAMERA_THROTTLE_XO_CLK 29
  38. #define GCC_CAMERA_XO_CLK 30
  39. #define GCC_CFG_NOC_USB3_MP_AXI_CLK 31
  40. #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK 32
  41. #define GCC_CFG_NOC_USB3_SEC_AXI_CLK 33
  42. #define GCC_CNOC_PCIE0_TUNNEL_CLK 34
  43. #define GCC_CNOC_PCIE1_TUNNEL_CLK 35
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  57. #define GCC_DISP_THROTTLE_RT_AXI_CLK 49
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  249. #define GCC_QUPV3_WRAP_1_S_AHB_CLK 241
  250. #define GCC_QUPV3_WRAP_2_M_AHB_CLK 242
  251. #define GCC_QUPV3_WRAP_2_S_AHB_CLK 243
  252. #define GCC_SDCC2_AHB_CLK 244
  253. #define GCC_SDCC2_APPS_CLK 245
  254. #define GCC_SDCC2_APPS_CLK_SRC 246
  255. #define GCC_SDCC4_AHB_CLK 247
  256. #define GCC_SDCC4_APPS_CLK 248
  257. #define GCC_SDCC4_APPS_CLK_SRC 249
  258. #define GCC_SYS_NOC_USB_AXI_CLK 250
  259. #define GCC_UFS_1_CARD_CLKREF_CLK 251
  260. #define GCC_UFS_CARD_AHB_CLK 252
  261. #define GCC_UFS_CARD_AXI_CLK 253
  262. #define GCC_UFS_CARD_AXI_CLK_SRC 254
  263. #define GCC_UFS_CARD_CLKREF_CLK 255
  264. #define GCC_UFS_CARD_ICE_CORE_CLK 256
  265. #define GCC_UFS_CARD_ICE_CORE_CLK_SRC 257
  266. #define GCC_UFS_CARD_PHY_AUX_CLK 258
  267. #define GCC_UFS_CARD_PHY_AUX_CLK_SRC 259
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  391. #define GCC_UFS_CARD_PHY_AUX_HW_CTL_CLK 383
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  397. /* GCC resets */
  398. #define GCC_EMAC0_BCR 0
  399. #define GCC_EMAC1_BCR 1
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  457. #define GCC_USB3_UNIPHY_MP0_BCR 59
  458. #define GCC_USB3_UNIPHY_MP1_BCR 60
  459. #define GCC_USB3PHY_PHY_PRIM_BCR 61
  460. #define GCC_USB3PHY_PHY_SEC_BCR 62
  461. #define GCC_USB3UNIPHY_PHY_MP0_BCR 63
  462. #define GCC_USB3UNIPHY_PHY_MP1_BCR 64
  463. #define GCC_USB4_1_BCR 65
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  466. #define GCC_USB4_1_PHY_PRIM_BCR 68
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  475. #define GCC_VIDEO_AXI0_CLK_ARES 77
  476. #define GCC_VIDEO_AXI1_CLK_ARES 78
  477. #endif