 Santosh Kumar Aenugu
|
6add9d0fc0
disp: msm: dsi: fix dsi pll dividers
|
4 ani în urmă |
 qctecmdr
|
bf67f9d761
Merge "disp: msm: typecast variables as long long for 64 bit operations"
|
4 ani în urmă |
 Satya Rama Aditya Pinapala
|
ef4dd310a4
disp: msm: dsi: update DSI PHY post divider for slave PLL
|
4 ani în urmă |
 Venkata Prahlad Valluru
|
2ec9452162
disp: msm: typecast variables as long long for 64 bit operations
|
4 ani în urmă |
 Amine Najahi
|
820849aeff
disp: msm: dsi: fix rate debug log
|
4 ani în urmă |
 Shashank Babu Chinta Venkata
|
4ee86a4a81
disp: msm: dsi: configure pll slave appropriately
|
4 ani în urmă |
|
Satya Rama Aditya Pinapala
|
7471069739
disp: msm: dsi: fix DSI PLL configuring sequence
|
4 ani în urmă |
|
qctecmdr
|
125cc02596
Merge "disp: msm: dsi: fix mutiplier frac_bits assignment"
|
4 ani în urmă |
|
Satya Rama Aditya Pinapala
|
7eef141621
disp: msms: dsi: avoid hardcoding pll_lockdet_rate
|
4 ani în urmă |
|
Satya Rama Aditya Pinapala
|
ddbd9adaaf
disp: msm: dsi: fix mutiplier frac_bits assignment
|
4 ani în urmă |
|
Satya Rama Aditya Pinapala
|
b54e355c84
disp: msm: dsi: fix pclk divider calculation
|
4 ani în urmă |
|
Satya Rama Aditya Pinapala
|
0a93edbae6
disp: msm: dsi: rework DSI PLL to be configured within PHY
|
5 ani în urmă |
|
Satya Rama Aditya Pinapala
|
fcb453c0b8
disp: msm: dsi: Add support for 5nm C-PHY shadow clock
|
4 ani în urmă |
 Ritesh Kumar
|
ba3d7304f5
disp: pll: Fix cfg1 value when pclk_src_mux parent is updated
|
4 ani în urmă |
 Yuan Zhao
|
00fd38bec4
disp: msm: pll: add additional dividers for CPHY support
|
5 ani în urmă |
|
Satya Rama Aditya Pinapala
|
e0a892dcd5
disp: msm: dsi: fix dsi pll debugfs errors
|
5 ani în urmă |
|
Satya Rama Aditya Pinapala
|
64ee7e84b3
disp: msm: dsi: call pll set rate directly instead of a function pointer cb
|
5 ani în urmă |
|
Satya Rama Aditya Pinapala
|
5694bc2eee
disp: msm: dsi: move dsi pll as subnode to dsi PHY
|
5 ani în urmă |
